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[디지털 시스템 설계 및 실험] Latch, Flip-Flop, Shift Register
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[디지털 시스템 설계 및 실험] La.hwp
- 등록인 leewk2547
- 등록/수정일 13.07.30 / 13.07.30
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- 보고서설명
- 1. SR NOR latch
2. Gated D latch(based on an SR NOR latch)
3. (Master?slave pulse-triggered) D flip-flop (with reset)
4. 4-bit shift register(using 4 D flip-flops)
- 본문일부/목차
- (Master&slave pulse-triggered) D flip-flop (with reset)
코딩
module dppr(D,C,R,Q,Q_);
input D,C,R;
output Q,Q_;
wire Q1,Q1_;
dl dl1 (AD,NC,Q1,Q1_);
dl dl2 (Q1,C,Q,Q_);
wire NR;
wire AD;
not (NR,R);
not (NC,C);
and (AD,D,NR);
endmodule
시뮬레이션
- 연관검색어
- #디지털 시스템 설계
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