해피레포트 - [레포트] 순차논리(Sequential logic) 래치 & 플립플롭 / 1. 순차논..

카테고리 : 레포트 > 기타 파일이름 :순차논리(Sequential logic) - 래치 & 플립플롭.hwp 문서분량 : 4 page 등록인 : behappy20 문서뷰어 : 한글뷰어프로그램 등록/수정일 : 07.12.07 / 07.12.07 구매평가 : 다운로드수 : 3 판매가격 : 500 원

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1. 순차논리(Sequential logic) - Latch Flip...

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1. 순차논리(Sequential logic) - Latch Flip-Flop 가. 실험목적 1) Latch와 Flip-Flop의 특성을 알아보자. 2) 클럭 신호에 따른 출력상태를 알아보자. 나. 실험장비 1) 부품 7-세그먼트 2개, 딥, 푸쉬, 토글 스위치 각각 1개, IC 72555 1개, 7421 1개, 7448 2개, 7475 1개, 7474 5개, LED 8개, 저항 270 10개, 1K 4개, 가변저항 47K 1개, 캐패시터 47㎌ 2) 장비 Bread Board, Power Supply 다. 기본이론 1) D Latch C D Q(t+1) 0 X 1 0 1 1 Q(t) No change 0 Reset 1 Set D 래치는 단지 D(data)와 C(control)의 2개의 입력만 가지고 있다. 입력 D는 제어입력을 가진 SR 래치의 입력 S에는 그대로 입력되고, 입력 R에는 보수가 되어 입력된다. 제어신호가 0에 있는 동안에는 교차결합된 SR 래치의 입력 S와 R이 모두 1에 있기 때문에 D값에 상관없이 회로의 상태는 그대로 유지된다. 단지 C=1일 때만 D의 입력이 회로에 영향을 미친다. 이 상태에서 D=1이면 Q=1이고 Q`=0이 되어 회로는 세트 상태가 된다. 또한 D=0이면, Q=0이고 Q`=1이 되어 회로는 리세트 상태가 된다. 2) D Flip-Flop D Q(t+1) 0 1 0 Reset 1 Set 상승-에지-트리거하는 플립플롭은 클럭 펄스가 상승 전이가 될 때만, D의 값이 Q에 전달된다. 클럭의 1에서 0으로의 하강 전이에 대해서는 출력이 변하지 않는다. 또한, CLK가 0 또는 1로 일정하게 유지될 때도 출력은 변하지 않는다. 그러므로 이 플립플롭은 클럭 펄스의 0에서 1로의 상승 전이에서만 응답하고, 나머지에 대해서는 절대 응답하지 않는다. 라. 실험과정 1) Cloc...

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