해피레포트 - [레포트] unit6 / Unit6 JK FLIP FLOP◈Unit ObjectJK f

카테고리 : 레포트 > 기타 파일이름 :unit6, Unit6 JK .hwp 문서분량 : 7 page 등록인 : deadfile 문서뷰어 : 한글뷰어프로그램 등록/수정일 : 08.10.09 / 08.10.09 구매평가 : 다운로드수 : 0 판매가격 : 1,000 원

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Unit6 JK FLIP-FLOP◈Unit ObjectJK flip-flop의 동작과 구성을 설명한다.◈Unit Fundamentals 위의 그림은 JK flip-flop을 도식적으로 보여준다. 두 개의 데이터 입력(J와 K)과 클럭입력으로 이루어져 있다. 이 JK-flip-flop은 negative clock edge 신호를 요구한다. 그러나 다른 JK flip-flop은 positive clock edge, logic1, 또는 logic0 클럭 신호를 요구하기도 한다. 게다가 대부분 JK flip-flop의 set과 reset은 비동기식 preset과 clear 입력이다. negative clock edge이나 positive clock edge의 논리 레벨은 PR 또는 CLR을 요구 하기도 한다. 출력 Q와 Q-not는 보수관계이다. 이 JK flip-flop에서 데이터 입력은 J와 K이다. JK flip-flop은 다목적이기 때문에 대부분의 flip-flop에서 사용된다.JK flip-flop은 RS flip-flop,T flip-flop(toggle flip-flop),D flip-flop ,master slave JK flip-flop등의 동작을 적용할 수 있다. 기본 JK flip-flop은 clock된 RS flip-flop이다. J와 K 입력은 R과 S입력과 비슷하다. T flip-flop은 JK 입력이 high로 set(logic1)된 JK flip-flop이다. T flip-flop의 출력은 매 clock 신호에 따라 상태가 변한다. D-type flip-flop은 입력 J와 K가 보수관계인 JK flip-flop이다. master-slave flip-flop은 master 출력이 slave의 입력에 연결된 두 개의 JK flip-flop이다. master-slave flip-flop은 출력 racing을 ...

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