해피레포트 - 전기전자 실험 - 선형 연산 증폭기 회로

카테고리 : 레포트 > 자연과학계열 파일이름 :전기전자 실험 - 선형 연산 증폭기.hwp 문서분량 : 5 page 등록인 : leewk2547 문서뷰어 : 한글뷰어프로그램 등록/수정일 : 15.02.15 / 15.02.15 구매평가 : 다운로드수 : 0 판매가격 : 2,000 원

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보고서설명
실험 순서 1. 반전 증폭기 a. 그림 29-5의 증폭기 회로에 대한 전압이득을 계산하라. b. 그림 29-5의 회로를 구성하라. 입력 Vi에 실효전압 1V를 인가하라. DMM을 사용하여 출력전압을 측정한 다음을 기록하라. Vo(측정값)=5.12V 측정값을 이용하여 전압이득을 계산하라.

본문일부/목차
기록하라. Vo(측정값)=6.06V c. R2를 100kΩ으로 바꾼 다음, 순서 4(a) 와 4(b)를 반복하라. Vo(계산값)=2V Vo(측정값)=2.02V 출력전압의 계산값과 비교하라. 0.02V의 미세한 오차가 나타났다. 5. 분석및 고찰 이번 실험은 선형 연산 증폭기 회오에 대한 실험을 하였습니다. 이번 실험은 연산증폭기는 반전 입력단자와 비반전 입력 단자를 가진 이득이 매우 큰 증폭이입니다. 이 증폭기는 외부에 저항을 추가하여 연산증폭기 자체의 이득보다 gnjfTLs 작지만 외부 저항만에 의해 결정되는 이득이 정확한 증폭기를 만들 수 있다는 이론을 가지고 실험을 진행하였습니다. 처음으로 반전 증폭기에 대한 실험을 하였습니다. 먼저 예상되는 전압이득값을 구하고 다음으로 측정한 값과 비교해 보았습닏. 반전 증폭기는 전압이득이 -1이 된다는 사실을 확인 할 수 있었습니다. 다음으로는 비반전 증폭기에 대한 실험을 하였습니다. 이번 실험역시 계산값과 측정값이 비슷하게 측정되었 비반전 증폭기의 특성에 대하여 알 수 있었습니다. 그리고 파형은 입력 파형 그대로 출력되어 나오는 것을 확인 할 수 있었습니다. 단위 이득 플로어에서는 전압이득이 1이고 출력 파형이 반전 되지 않았습니다. 모두 비슷한 실험이여서 쉽게 진행할 수 있었고 회로의 구성에 EK라 증폭기가 어떤식으로 사용될 수 있는지 알 수 있었습니다.

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